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名稱：基于FPGA的電子琴設計Verilog代碼VIVADO 硬木課堂開發(fā)板

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04/03 08:37

verilog vivado

ModelSim是Mentor公司的語言仿真器，支持Windows和Linux系統，是單一內核支持VHDL和Verilog混合仿真的仿真器。它采用直接優(yōu)化的編譯技術、單一內核仿真，不僅編譯仿真速度業(yè)界最快、編譯的代碼與平臺無關，而且便于保護IP核。它還提供了友好的調試環(huán)境，具有個性化的圖形界面和用戶接口，為用戶加快調試提供強有力的手段，是FPGA/ASIC設計的首選仿真軟件。

郝旭帥電子設計團隊

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03/19 09:05

vivado ModelSim

Vivado里如何把emacs設為默認編輯器

習慣了用linux下emacs寫代碼，最近換到了windows下開發(fā)fpga，也想用emacs，怎么辦呢？原來在Vivado IDE里就可以設置，但也有一些注意事項。

陳鋒

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03/06 13:30

vivado 編輯器

基于 FPGA Vivado 的數字鐘設計（附源工程）

今天給大俠帶來基于 FPGA Vivado 的數字鐘設計，開發(fā)板實現使用的是Digilent basys 3。話不多說，上貨。本篇掌握基于diagram的Vivado工程設計流程，學會使用IP集成器，添加 IP 目錄并調用其中的IP。本篇實現了一個簡單的數字鐘，能實現計時的功能。由于數碼管只有4位，因此本數字鐘只能計分和秒。本系統的邏輯部分主要由74系列的IP構成。

FPGA技術江湖

3606

2024/12/23

vivado 數字鐘

FPGA開源項目，應該怎么找？

今天給大俠帶來在FPGA技術交流群里平時討論的問題答疑合集（十九），以后還會多推出本系列，話不多說，上貨。Q：想找一些fpga的開源項目，應該怎么找，或者說那些開源網站上，我怎么接開源項目，我能做什么？

FPGA技術江湖

3689

2024/09/30

FPGA vivado

FIFO復位流程

在FIFO的使用過程中不可避免的在某些應用下必須使用reset信號，將當前FIFO中數據清空，但是我們現在調用的xilinx的FIFO核在復位條件不滿足時會偶現FIFO進入復位狀態(tài)無法恢復，必須重新斷上電才能恢復的問題，所以在使用FIFO時我們必須嚴格的按照datasheet上要求執(zhí)行，以免出現異常。

森森Tech

3395

2024/09/03

xilinx vivado

Vivado使用小技巧

1.安裝Vivado 2017.4后，打開軟件出現如下圖“應用程序無法正常啟動（0xc000007b）”錯誤：

FPGA技術實戰(zhàn)

3791

2024/05/20

vivado

vivado使用tcl和tcl打開vivado工程的方法

把vivado工程保存成.tcl文件，有兩種方法，分別是：① 使用tcl命令：在打開的vivado工程中，在tcl命令輸入行，輸入如下命令，write_project_tcl { d:/work/system.tcl}，即可把工程保存成.tcl文件。其中d:/work/是.tcl文件保存的路徑，可根據實際使用的需要更改，system.tcl是保存的文件名。

森森Techdaily

1.4萬

2024/05/12

vivado

FPGA Vivado調用IP核詳細操作步驟

今天給大俠帶來Vivado調用IP核詳細操作步驟，手把手教學，請往下看。話不多說，上貨。首先咱們來了解一下vivado的IP核，IP核（IP Core）：Vivado中有很多IP核可以直接使用，例如數學運算（乘法器、除法器、浮點運算器等）、信號處理（FFT、DFT、DDS等）。

FPGA技術江湖

1.8萬

2024/05/09

FPGA vivado

Vivado編譯常見錯誤合集（一）

本文對Vivado編譯時常見的錯誤或者關鍵警告做一些梳理匯總，便于日后歸納總結。

FPGA技術實戰(zhàn)

1.1萬

2024/04/15

vivado 編譯

Vivado 使用Simulink設計FIR濾波器

今天給大俠帶來Vivado經典案例：使用Simulink設計FIR濾波器，話不多說，上貨。FIR(Finite Impulse Response)濾波器：有限長單位沖激響應濾波器，又稱為非遞歸型濾波器，是數字信號處理系統中最基本的元件，它可以在保證任意幅頻特性的同時具有嚴格的線性相頻特性，同時其單位抽樣響應是有限長的，因而濾波器是穩(wěn)定的系統。因此，FIR濾波器在通信、圖像處理、模式識別等領域都有著廣泛的應用。

FPGA技術江湖

3289

2024/03/25

vivado Simulink

Vivado DDS IP核仿真

直接數字合成器（DDS）或數控振蕩器（NCO）是許多數字通信系統中的重要部件。正交合成器用于構造數字下變頻器和上變頻器、解調器，并實現各種類型的調制方案，包括PSK（相移鍵控）、FSK（頻移鍵控（frequency shift keying））和MSK（minimum shift keyed）。

lee

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2024/02/18

vivado dds

Xilinx FPGA Partial Reconfiguration 部分重配置詳細教程

Partial Reconfiguration（部分重配置）在現在的FPGA應用中越來越常見，我們這次的教程以Project模式為例來說明部分重配置的操作過程。這里我們使用的Vivado版本是2017.2，使用的例程是Vivado自帶的wavegen工程，并在工程中增加一個計數器模塊，如下圖所示

森森Techdaily

4571

2024/02/10

vivado Xilinx FPGA

Xilinx FPGA Partial Reconfiguration 部分重配置詳細教程

FPGA零基礎學習之Vivado-VGA驅動設計

本系列將帶來FPGA的系統性學習，從最基本的數字電路基礎開始，最詳細操作步驟，最直白的言語描述，手把手的“傻瓜式”講解，讓電子、信息、通信類專業(yè)學生、初入職場小白及打算進階提升的職業(yè)開發(fā)者都可以有系統性學習的機會。系統性的掌握技術開發(fā)以及相關要求，對個人就業(yè)以及職業(yè)發(fā)展都有著潛在的幫助，希望對大家有所幫助。本次帶來Vivado系列，VGA驅動設計。話不多說，上貨。

FPGA技術江湖

1884

2023/10/26

FPGA VGA

FPGA零基礎學習之Vivado-超聲波驅動設計

大俠好，歡迎來到FPGA技術江湖。本系列將帶來FPGA的系統性學習，從最基本的數字電路基礎開始，最詳細操作步驟，最直白的言語描述，手把手的“傻瓜式”講解，讓電子、信息、通信類專業(yè)學生、初入職場小白及打算進階提升的職業(yè)開發(fā)者都可以有系統性學習的機會。

FPGA技術江湖

2205

2023/10/18

FPGA 超聲波測距

FPGA零基礎學習之Vivado-EEPROM驅動設計

本系列將帶來FPGA的系統性學習，從最基本的數字電路基礎開始，最詳細操作步驟，最直白的言語描述，手把手的“傻瓜式”講解，讓電子、信息、通信類專業(yè)學生、初入職場小白及打算進階提升的職業(yè)開發(fā)者都可以有系統性學習的機會。本次帶來Vivado系列，EEPROM驅動設計。話不多說，上貨。

FPGA技術江湖

1850

2023/08/24

EEPROM vivado

FPGA零基礎學習之Vivado-TLC5620驅動教程

本系列將帶來FPGA的系統性學習，從最基本的數字電路基礎開始，最詳細操作步驟，最直白的言語描述，手把手的“傻瓜式”講解，讓電子、信息、通信類專業(yè)學生、初入職場小白及打算進階提升的職業(yè)開發(fā)者都可以有系統性學習的機會。本次帶來Vivado系列，TLC5620驅動教程。話不多說，上貨。

FPGA技術江湖

2623

2023/08/04

vivado