合見工軟發(fā)布先進工藝多協(xié)議兼容、集成化傳輸接口SerDes IP解決方案

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中國數(shù)字EDA/IP龍頭企業(yè)上海合見工業(yè)軟件集團有限公司（簡稱“合見工軟”）發(fā)布國產(chǎn)自主研發(fā)支持多協(xié)議的32G SerDes PHY 解決方案UniVista 32G Multi-Protocol SerDes IP (簡稱UniVista 32G MPS IP)。該多協(xié)議PHY產(chǎn)品可支持PCIe5、USB4、以太網(wǎng)、SRIO、JESD204C等多種主流和專用協(xié)議，并支持多家先進工藝，成功應用在高性能計算、人工智能AI、數(shù)據(jù)中心等復雜網(wǎng)絡領域IC企業(yè)芯片中部署。

隨著全球數(shù)據(jù)量呈指數(shù)級增長，這場由數(shù)據(jù)驅(qū)動的智能革命，引發(fā)了針對算力、架構、網(wǎng)絡基礎設施等核心技術的根本性重構。芯片底層互聯(lián)技術也因此在快速創(chuàng)新，SerDes技術作為數(shù)字世界的“數(shù)據(jù)大動脈”正在經(jīng)歷前所未有的變革。數(shù)據(jù)洪流直接推動了SerDes技術從速率、架構到應用場景的全面升級，以滿足高性能、高穩(wěn)定性、低能耗和靈活配置的高速數(shù)據(jù)傳輸需求。

UniVista 32G MPS IP由硬化模塊（PMA/SerDes）和RTL模塊（Raw PCS）組成，支持高達32 Gbps的數(shù)據(jù)傳輸速率（例如PCIe Gen5速率下32.0GT/s），全面支持 PCIe Gen1-5、USB4、以太網(wǎng)（25GKR、10GKR）、SRIO、JESD204C等多種主流和專用協(xié)議。其SerDes接口更提供多種數(shù)據(jù)位寬選項，具備獨立的發(fā)送和接收同步時鐘，并包含訓練功能。UniVista MPS IP可充分滿足數(shù)據(jù)中心、高性能計算、網(wǎng)絡設備等應用領域?qū)Ω咚倩ミB的嚴苛需求，經(jīng)過嚴格驗證與深度評估，可在各種應用場景中均表現(xiàn)出優(yōu)異的穩(wěn)定性和可靠性。

UniVista 32G MPS IP具備以下核心優(yōu)勢：

  • 支持多種協(xié)議標準：PCIe Gen1/2/3/4/5、USB4、以太網(wǎng)（25GKR、10GKR）、SRIO、JESD204C。
  • 靈活的配置架構：硬化模塊支持X1、X2、X4通道配置，支持差分傳輸，最高可達X16 PHY配置。
  • 先進的均衡技術：自適應 Rx CTLE 和 DFE，以及帶有高分辨率的多抽頭 Tx 均衡器。
  • 完善的測試功能：內(nèi)置BIST（Build-In-Self-Test）、支持近端模擬環(huán)回、遠端數(shù)字/模擬環(huán)回，以及IEEE 1149.1和1149.6邊界掃描支持。
  • 精細化低功耗設計：通過PLL控制、參考時鐘控制及嵌入式電源門控等技術，支持L1/L1.0/L1.1/L1.2/L2等多種低功耗狀態(tài)及L1子狀態(tài)精細管理，并符合PIPE v5.2接口規(guī)范。

合見工軟副總裁劉矛表示：“在數(shù)據(jù)量以指數(shù)級增長的時代，高性能計算、智算、數(shù)據(jù)中心等等應用都對芯片底層互聯(lián)與外部數(shù)據(jù)通信提出了更嚴苛的要求，高速串行通信SerDes作為互聯(lián)接口的核心技術，對國產(chǎn)高端數(shù)字芯片的自主可控需求至關重要。合見工軟UniVista 32G MPS IP解決方案，憑借高性能、高穩(wěn)定性、低能耗和靈活配置，滿足高速數(shù)據(jù)傳輸需求，為客戶提供高可靠性的先進接口IP整體解決方案，經(jīng)過實際驗證，可幫助客戶在面對新的接口實現(xiàn)應用時，大幅提高性能和改善能效，實現(xiàn)一次性流片成功，縮短產(chǎn)品的上市周期。合見工軟志在將真正自主可控的IP產(chǎn)品和EDA產(chǎn)品一起為客戶提供完整可靠的芯片設計方案?！?/p>

合見工軟自主知識產(chǎn)權的全國產(chǎn)IP解決方案是合見工軟更廣泛的EDA+IP產(chǎn)品戰(zhàn)略的重要組成，合見工軟的高速接口IP解決方案已實現(xiàn)了國產(chǎn)化技術突破，引領智算、HPC、通信、自動駕駛、工業(yè)物聯(lián)網(wǎng)等領域大算力芯片的性能突破及爆發(fā)式發(fā)展。

合見工軟目前可提供的廣泛IP解決方案包括：UniVista PCIe Gen5完整解決方案，以太網(wǎng)(Ethernet)、靈活以太網(wǎng)(FlexE)、Interlaken等多種高速互聯(lián)接口控制器，ETH-X傳輸層協(xié)議(PAXI)IP和VIP產(chǎn)品，智算網(wǎng)絡解決方案RDMA IP，Memory?接口HBM3/E、DDR5 、LPDDR5 IP，HiPi標準IP/VIP，針對先進封裝芯粒（Chiplet）集成的關鍵標準UCIe IP，并實現(xiàn)國產(chǎn)首個跨工藝節(jié)點的UCIe IP互連技術驗證，在采用臺積電N6和三星SF5工藝制造的UCIe測試芯片之間成功完成互操作性測試，實現(xiàn)D2D和C2C互連應用。

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